YOU SAID:

This instruction is writemasked, so only those elements with the corresponding bit set in vector mask register k1 are computed and stored into zmm1. Elements in zmm1 with the corresponding bit clear in k1 retain their previous values (merging-masking) or are set to 0 (zeroing-masking).

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この命令はライトマスクされているので、ベクトルマスクレジスタk1の対応するビットがセットされている要素だけが計算され、zmm1に格納されます。 k1内の対応するビットがクリアされているzmm1内の要素は、前の値を保持するか（マージマスキング）、または0に設定されます（ゼロマスキング）。

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Since this instruction is write-masked, only the element for which the corresponding bit of vector mask register k1 is set is calculated and stored in zmm1. The corresponding bit in k1 is cleared The element in zmm1 holds the previous value (merge masking), or 0

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この命令はライトマスクされているため、ベクトルマスクレジスタk1の対応するビットが設定されている要素のみが計算され、zmm1に格納されます。 k1内の対応するビットがクリアされますzmm1内のエレメントは前の値（マージ・マスキング）、または0を保持します

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Only elements that set the bit vector mask register K1 for this instruction light mask is the computed and stored in the zmm1. element K1 in the corresponding bit is cleared in the zmm1 holds the previous value (merge-masking), or 0 will

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この命令ライトマスクに対してビットベクトルマスクレジスタＫ１を設定する要素のみが計算され、ｚｍｍ１に格納される。対応するビットの要素K1がzmm1でクリアされて前の値を保持する（マージマスク）、または0

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For this instruction write mask, only the elements that set the bit vector mask register K 1 are calculated and stored in z mm 1. Element K1 of the corresponding bit is cleared with zmm1 to hold the previous value (merge mask), or 0

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この命令書き込みマスクのビット ベクトル マスク レジスタ 1 K 設定の要素だけが計算され、z mm 1 に格納されています。(差し込み印刷マスク) の前の値または 0 を保持する zmm1 の対応するビットの要素 K1 をクリアします。

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Calculates only the settings element instructions write mask bit vector mask register 1 K a z mm 1 is stored. (Mail merge printing mask) of clear the corresponding bit in the zmm1 that holds the previous value or 0 elements K1.

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設定要素の指示のみ書き込みマスク ビット ベクトル マスク レジスタ z mm 1 が格納されている 1 K を計算します。(差し込み印刷マスク) のクリア、zmm1 の対応するビットを保持する前の値または 0 要素 K1。

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Calculates only an indication of a configuration element that contains a write mask bit vector mask register z mm 1 1 K. (Mail merge printing mask) in front to keep clear the corresponding zmm1 bit or 0 elements K1.

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書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) を維持する前にオフに対応する zmm1 ビット 1 の 1 を含む構成要素または要素がゼロ K1 の指示のみを計算します。

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Calculates the element configuration element containing the corresponding off to keep the write mask bit vector mask register z mm sum (mail merge printing mask) zmm1-bit 1 1 or zero K1 instruction only.

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Zmm1 ビット書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) を維持するに対応するを含む構成要素を計算 1 1 またはゼロの K1 の命令のみ。

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Corresponds to the Zmm1 bit write mask bit vector mask register z mm sum (mail merge printing mask) to maintain configuration element contains a calculation 1 1 or K1 of the zero order only.

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Zmm1 ビット書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) の構成要素を含む計算 1 1 またはゼロの順序だけの K1 を維持するに対応します。

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Zmm1-bit write mask bit vector mask register z mm sum (mail merge printing mask) constructs, calculating one corresponds to maintain only one or zero order K1.

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Zmm1 ビット書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) を構築、計算できるものだけ 1 つまたはゼロ順序 K1 を維持するために対応します。

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Support to maintain the zero-sequence or K1 only one build Zmm1-bit write mask bit vector mask register z mm sum (mail merge printing mask), can be calculated.

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ゼロ順序または K1 1 つだけビルド Zmm1 ビット書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) を維持するためにサポートを計算できます。

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You can calculate the support to maintain only a single zero-sequence or K1 build Zmm1-bit write mask bit vector mask register z mm sum (mail merge printing mask).

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のみ単一ゼロ順序を維持するためにサポートを求めることができます。 または K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク レジスタ z mm 和 (差し込み印刷マスク) を構築します。

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Only you can help to maintain a single zero-sequence. Building K1 Zmm1-bit write mask bit vector mask register z mm WA (mail merge printing mask) or.

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のみ 1 つのゼロ順序を維持するためにすることができます。Z ミリメートル WA (差し込み印刷マスク) を登録 K1 Zmm1 ビット書き込みマスク ビット ベクトル マスクを構築または。

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Only you may want to maintain one zero order. Build registration K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or.

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1 つを維持する可能性がありますのみ注文をゼロします。登録 K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク Z ミリメートル WA (差し込み印刷マスク) を構築または。

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There is likely to remain one of only the zero order. To register K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or building.

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だけで、ゼロの順序のままに可能性があります。K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク Z ミリメートル WA (差し込み印刷マスク) を登録するまたは建物します。

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Only the zero order in May. To register K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or building.

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だけゼロ順序 5 月。K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク Z ミリメートル WA (差し込み印刷マスク) を登録するまたは建物します。

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Only zero-sequence 5. To register K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or building.

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唯一 0 シーケンス 5。K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク Z ミリメートル WA (差し込み印刷マスク) を登録するまたは建物します。

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Only 0 sequence 5. To register K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or building.

INTO JAPANESE

のみ 0 シーケンス 5。K1 Zmm1 ビット書き込みマスク ビット ベクトル マスク Z ミリメートル WA (差し込み印刷マスク) を登録するまたは建物します。

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Only 0 sequence 5. To register K1 Zmm1-bit write mask bit vector mask Z mm WA (mail merge printing mask) or building.